| 1 |
32 |
redbear |
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
|
| 2 |
|
|
; Legal Partition Candidates ;
|
| 3 |
|
|
+-----------------------------------------------------------------------------------------------------------------------------------+-------+----------------+--------------+----------------+--------+-----------------+---------------+-----------------+-------+----------------+--------------+------------------+-------------------+
|
| 4 |
|
|
; Hierarchy ; Input ; Constant Input ; Unused Input ; Floating Input ; Output ; Constant Output ; Unused Output ; Floating Output ; Bidir ; Constant Bidir ; Unused Bidir ; Input only Bidir ; Output only Bidir ;
|
| 5 |
|
|
+-----------------------------------------------------------------------------------------------------------------------------------+-------+----------------+--------------+----------------+--------+-----------------+---------------+-----------------+-------+----------------+--------------+------------------+-------------------+
|
| 6 |
40 |
redbear |
; m_x|cnt_neg ; 3 ; 0 ; 0 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 7 |
|
|
; m_x|capture_c ; 4 ; 0 ; 0 ; 0 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 8 |
|
|
; m_x|capture_d ; 4 ; 0 ; 0 ; 0 ; 10 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 9 |
32 |
redbear |
; m_x ; 3 ; 0 ; 0 ; 0 ; 14 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 10 |
|
|
; R_400_to_2_5_10_100_200_300MHZ ; 5 ; 0 ; 0 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 11 |
|
|
; db_system_spwulight_b ; 2 ; 0 ; 0 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 12 |
40 |
redbear |
; A_SPW_TOP|tx_data|mem_dta_fifo_tx ; 23 ; 0 ; 0 ; 0 ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 13 |
32 |
redbear |
; A_SPW_TOP|tx_data ; 13 ; 0 ; 0 ; 0 ; 18 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 14 |
40 |
redbear |
; A_SPW_TOP|rx_data|mem_dta_fifo_tx ; 23 ; 0 ; 0 ; 0 ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 15 |
32 |
redbear |
; A_SPW_TOP|rx_data ; 13 ; 0 ; 0 ; 0 ; 19 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 16 |
40 |
redbear |
; A_SPW_TOP|SPW|TX|tx_data_snd ; 24 ; 0 ; 0 ; 0 ; 29 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 17 |
|
|
; A_SPW_TOP|SPW|TX|tx_fsm|tx_fct_snd ; 4 ; 0 ; 0 ; 0 ; 3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 18 |
|
|
; A_SPW_TOP|SPW|TX|tx_fsm|tx_fct_cnt ; 4 ; 0 ; 0 ; 0 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 19 |
|
|
; A_SPW_TOP|SPW|TX|tx_fsm ; 35 ; 0 ; 0 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 20 |
32 |
redbear |
; A_SPW_TOP|SPW|TX ; 25 ; 0 ; 0 ; 0 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 21 |
40 |
redbear |
; A_SPW_TOP|SPW|RX|rx_dtarcv ; 25 ; 0 ; 0 ; 0 ; 25 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 22 |
|
|
; A_SPW_TOP|SPW|RX|cnt_neg ; 3 ; 0 ; 0 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 23 |
|
|
; A_SPW_TOP|SPW|RX|capture_c ; 4 ; 0 ; 0 ; 0 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 24 |
|
|
; A_SPW_TOP|SPW|RX|capture_d ; 4 ; 0 ; 0 ; 0 ; 10 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 25 |
|
|
; A_SPW_TOP|SPW|RX|data_control ; 25 ; 0 ; 0 ; 0 ; 19 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 26 |
|
|
; A_SPW_TOP|SPW|RX|control_data_rdy ; 18 ; 0 ; 0 ; 0 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 27 |
|
|
; A_SPW_TOP|SPW|RX|buffer_data_flag ; 10 ; 0 ; 0 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 28 |
|
|
; A_SPW_TOP|SPW|RX|buffer_fsm ; 5 ; 0 ; 0 ; 0 ; 3 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 29 |
32 |
redbear |
; A_SPW_TOP|SPW|RX ; 3 ; 0 ; 0 ; 0 ; 26 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 30 |
|
|
; A_SPW_TOP|SPW|FSM ; 12 ; 1 ; 0 ; 1 ; 10 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 31 |
|
|
; A_SPW_TOP|SPW ; 29 ; 0 ; 0 ; 0 ; 29 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 32 |
|
|
; A_SPW_TOP ; 28 ; 0 ; 0 ; 0 ; 43 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 33 |
|
|
; u0|rst_controller_001|alt_rst_req_sync_uq1 ; 2 ; 1 ; 0 ; 1 ; 1 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 34 |
|
|
; u0|rst_controller_001|alt_rst_sync_uq1 ; 2 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 35 |
|
|
; u0|rst_controller_001 ; 33 ; 31 ; 0 ; 31 ; 1 ; 31 ; 31 ; 31 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 36 |
|
|
; u0|rst_controller|alt_rst_req_sync_uq1 ; 2 ; 1 ; 0 ; 1 ; 1 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 37 |
|
|
; u0|rst_controller|alt_rst_sync_uq1 ; 2 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 38 |
|
|
; u0|rst_controller ; 33 ; 31 ; 0 ; 31 ; 1 ; 31 ; 31 ; 31 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 39 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_021|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 40 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_021 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 41 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_020|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 42 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_020 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 43 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_019|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 44 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_019 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 45 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_018|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 46 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_018 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 47 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_017|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 48 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_017 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 49 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_016|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 50 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_016 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 51 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_015|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 52 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_015 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 53 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_014|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 54 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_014 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 55 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_013|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 56 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_013 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 57 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_012|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 58 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_012 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 59 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_011|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 60 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_011 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 61 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_010|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 62 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_010 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 63 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_009|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 64 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_009 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 65 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_008|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 66 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_008 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 67 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_007|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 68 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_007 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 69 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_006|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 70 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_006 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 71 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_005|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 72 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_005 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 73 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_004|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 74 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_004 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 75 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_003|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 76 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_003 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 77 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_002|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 78 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_002 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 79 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_001|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 80 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter_001 ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 81 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter|error_adapter_0 ; 38 ; 1 ; 2 ; 1 ; 37 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 82 |
|
|
; u0|mm_interconnect_0|avalon_st_adapter ; 38 ; 0 ; 0 ; 0 ; 37 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 83 |
|
|
; u0|mm_interconnect_0|rsp_mux_001|arb|adder ; 88 ; 44 ; 0 ; 44 ; 44 ; 44 ; 44 ; 44 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 84 |
|
|
; u0|mm_interconnect_0|rsp_mux_001|arb ; 26 ; 0 ; 4 ; 0 ; 22 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 85 |
|
|
; u0|mm_interconnect_0|rsp_mux_001 ; 3391 ; 0 ; 0 ; 0 ; 176 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 86 |
|
|
; u0|mm_interconnect_0|rsp_mux|arb|adder ; 88 ; 44 ; 0 ; 44 ; 44 ; 44 ; 44 ; 44 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 87 |
|
|
; u0|mm_interconnect_0|rsp_mux|arb ; 26 ; 0 ; 4 ; 0 ; 22 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 88 |
|
|
; u0|mm_interconnect_0|rsp_mux ; 3391 ; 0 ; 0 ; 0 ; 176 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 89 |
|
|
; u0|mm_interconnect_0|rsp_demux_021 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 90 |
|
|
; u0|mm_interconnect_0|rsp_demux_020 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 91 |
|
|
; u0|mm_interconnect_0|rsp_demux_019 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 92 |
|
|
; u0|mm_interconnect_0|rsp_demux_018 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 93 |
|
|
; u0|mm_interconnect_0|rsp_demux_017 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 94 |
|
|
; u0|mm_interconnect_0|rsp_demux_016 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 95 |
|
|
; u0|mm_interconnect_0|rsp_demux_015 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 96 |
|
|
; u0|mm_interconnect_0|rsp_demux_014 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 97 |
|
|
; u0|mm_interconnect_0|rsp_demux_013 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 98 |
|
|
; u0|mm_interconnect_0|rsp_demux_012 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 99 |
|
|
; u0|mm_interconnect_0|rsp_demux_011 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 100 |
|
|
; u0|mm_interconnect_0|rsp_demux_010 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 101 |
|
|
; u0|mm_interconnect_0|rsp_demux_009 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 102 |
|
|
; u0|mm_interconnect_0|rsp_demux_008 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 103 |
|
|
; u0|mm_interconnect_0|rsp_demux_007 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 104 |
|
|
; u0|mm_interconnect_0|rsp_demux_006 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 105 |
|
|
; u0|mm_interconnect_0|rsp_demux_005 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 106 |
|
|
; u0|mm_interconnect_0|rsp_demux_004 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 107 |
|
|
; u0|mm_interconnect_0|rsp_demux_003 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 108 |
|
|
; u0|mm_interconnect_0|rsp_demux_002 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 109 |
|
|
; u0|mm_interconnect_0|rsp_demux_001 ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 110 |
|
|
; u0|mm_interconnect_0|rsp_demux ; 158 ; 4 ; 2 ; 4 ; 309 ; 4 ; 4 ; 4 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 111 |
|
|
; u0|mm_interconnect_0|cmd_mux_021|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 112 |
|
|
; u0|mm_interconnect_0|cmd_mux_021|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 113 |
|
|
; u0|mm_interconnect_0|cmd_mux_021 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 114 |
|
|
; u0|mm_interconnect_0|cmd_mux_020|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 115 |
|
|
; u0|mm_interconnect_0|cmd_mux_020|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 116 |
|
|
; u0|mm_interconnect_0|cmd_mux_020 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 117 |
|
|
; u0|mm_interconnect_0|cmd_mux_019|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 118 |
|
|
; u0|mm_interconnect_0|cmd_mux_019|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 119 |
|
|
; u0|mm_interconnect_0|cmd_mux_019 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 120 |
|
|
; u0|mm_interconnect_0|cmd_mux_018|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 121 |
|
|
; u0|mm_interconnect_0|cmd_mux_018|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 122 |
|
|
; u0|mm_interconnect_0|cmd_mux_018 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 123 |
|
|
; u0|mm_interconnect_0|cmd_mux_017|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 124 |
|
|
; u0|mm_interconnect_0|cmd_mux_017|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 125 |
|
|
; u0|mm_interconnect_0|cmd_mux_017 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 126 |
|
|
; u0|mm_interconnect_0|cmd_mux_016|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 127 |
|
|
; u0|mm_interconnect_0|cmd_mux_016|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 128 |
|
|
; u0|mm_interconnect_0|cmd_mux_016 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 129 |
|
|
; u0|mm_interconnect_0|cmd_mux_015|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 130 |
|
|
; u0|mm_interconnect_0|cmd_mux_015|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 131 |
|
|
; u0|mm_interconnect_0|cmd_mux_015 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 132 |
|
|
; u0|mm_interconnect_0|cmd_mux_014|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 133 |
|
|
; u0|mm_interconnect_0|cmd_mux_014|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 134 |
|
|
; u0|mm_interconnect_0|cmd_mux_014 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 135 |
|
|
; u0|mm_interconnect_0|cmd_mux_013|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 136 |
|
|
; u0|mm_interconnect_0|cmd_mux_013|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 137 |
|
|
; u0|mm_interconnect_0|cmd_mux_013 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 138 |
|
|
; u0|mm_interconnect_0|cmd_mux_012|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 139 |
|
|
; u0|mm_interconnect_0|cmd_mux_012|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 140 |
|
|
; u0|mm_interconnect_0|cmd_mux_012 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 141 |
|
|
; u0|mm_interconnect_0|cmd_mux_011|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 142 |
|
|
; u0|mm_interconnect_0|cmd_mux_011|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 143 |
|
|
; u0|mm_interconnect_0|cmd_mux_011 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 144 |
|
|
; u0|mm_interconnect_0|cmd_mux_010|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 145 |
|
|
; u0|mm_interconnect_0|cmd_mux_010|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 146 |
|
|
; u0|mm_interconnect_0|cmd_mux_010 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 147 |
|
|
; u0|mm_interconnect_0|cmd_mux_009|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 148 |
|
|
; u0|mm_interconnect_0|cmd_mux_009|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 149 |
|
|
; u0|mm_interconnect_0|cmd_mux_009 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 150 |
|
|
; u0|mm_interconnect_0|cmd_mux_008|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 151 |
|
|
; u0|mm_interconnect_0|cmd_mux_008|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 152 |
|
|
; u0|mm_interconnect_0|cmd_mux_008 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 153 |
|
|
; u0|mm_interconnect_0|cmd_mux_007|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 154 |
|
|
; u0|mm_interconnect_0|cmd_mux_007|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 155 |
|
|
; u0|mm_interconnect_0|cmd_mux_007 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 156 |
|
|
; u0|mm_interconnect_0|cmd_mux_006|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 157 |
|
|
; u0|mm_interconnect_0|cmd_mux_006|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 158 |
|
|
; u0|mm_interconnect_0|cmd_mux_006 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 159 |
|
|
; u0|mm_interconnect_0|cmd_mux_005|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 160 |
|
|
; u0|mm_interconnect_0|cmd_mux_005|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 161 |
|
|
; u0|mm_interconnect_0|cmd_mux_005 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 162 |
|
|
; u0|mm_interconnect_0|cmd_mux_004|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 163 |
|
|
; u0|mm_interconnect_0|cmd_mux_004|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 164 |
|
|
; u0|mm_interconnect_0|cmd_mux_004 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 165 |
|
|
; u0|mm_interconnect_0|cmd_mux_003|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 166 |
|
|
; u0|mm_interconnect_0|cmd_mux_003|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 167 |
|
|
; u0|mm_interconnect_0|cmd_mux_003 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 168 |
|
|
; u0|mm_interconnect_0|cmd_mux_002|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 169 |
|
|
; u0|mm_interconnect_0|cmd_mux_002|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 170 |
|
|
; u0|mm_interconnect_0|cmd_mux_002 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 171 |
|
|
; u0|mm_interconnect_0|cmd_mux_001|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 172 |
|
|
; u0|mm_interconnect_0|cmd_mux_001|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 173 |
|
|
; u0|mm_interconnect_0|cmd_mux_001 ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 174 |
|
|
; u0|mm_interconnect_0|cmd_mux|arb|adder ; 8 ; 2 ; 0 ; 2 ; 4 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 175 |
|
|
; u0|mm_interconnect_0|cmd_mux|arb ; 6 ; 0 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 176 |
|
|
; u0|mm_interconnect_0|cmd_mux ; 311 ; 0 ; 0 ; 0 ; 156 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 177 |
|
|
; u0|mm_interconnect_0|cmd_demux_001 ; 199 ; 484 ; 2 ; 484 ; 3389 ; 484 ; 484 ; 484 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 178 |
|
|
; u0|mm_interconnect_0|cmd_demux ; 199 ; 484 ; 2 ; 484 ; 3389 ; 484 ; 484 ; 484 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 179 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|dc_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 180 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|dc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 181 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|db_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 182 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|db_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 183 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|da_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 184 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|da_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 185 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|bc_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 186 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|bc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 187 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ac_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 188 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ac_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 189 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ab_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 190 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ab_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 191 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min ; 31 ; 0 ; 2 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 192 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_burstwrap_increment ; 7 ; 0 ; 0 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 193 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|align_address_to_size ; 38 ; 5 ; 0 ; 5 ; 32 ; 5 ; 5 ; 5 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 194 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter ; 157 ; 0 ; 0 ; 0 ; 155 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 195 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_burst_adapter ; 157 ; 0 ; 0 ; 0 ; 155 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 196 |
|
|
; u0|mm_interconnect_0|counter_tx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|dc_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 197 |
|
|
; u0|mm_interconnect_0|counter_tx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|dc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 198 |
|
|
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| 199 |
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| 200 |
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| 201 |
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| 202 |
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| 203 |
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; u0|mm_interconnect_0|counter_tx_fifo_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|bc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 204 |
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| 205 |
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| 206 |
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| 207 |
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| 208 |
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| 209 |
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| 210 |
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| 211 |
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| 212 |
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| 213 |
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| 214 |
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| 215 |
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| 216 |
|
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|
| 218 |
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|
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|
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|
| 220 |
|
|
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|
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|
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|
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|
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|
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|
|
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| 224 |
|
|
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| 225 |
|
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|
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|
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|
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|
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|
| 231 |
|
|
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|
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|
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|
| 233 |
|
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|
| 235 |
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|
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|
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|
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|
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|
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|
|
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|
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|
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|
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|
|
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|
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|
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|
|
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|
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|
|
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|
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|
|
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|
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|
|
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|
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|
|
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|
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|
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|
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|
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|
| 261 |
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|
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|
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|
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|
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| 267 |
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| 269 |
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|
| 270 |
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| 271 |
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| 272 |
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| 273 |
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|
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| 274 |
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| 275 |
|
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; u0|mm_interconnect_0|timecode_tx_ready_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ab_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 276 |
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| 277 |
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| 278 |
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| 279 |
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| 280 |
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| 281 |
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| 282 |
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| 283 |
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| 284 |
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| 285 |
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| 286 |
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| 287 |
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| 288 |
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| 289 |
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| 290 |
|
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| 291 |
|
|
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|
| 292 |
|
|
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| 293 |
|
|
; u0|mm_interconnect_0|timecode_tx_enable_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min ; 31 ; 0 ; 2 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 294 |
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| 295 |
|
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|
| 296 |
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| 297 |
|
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| 298 |
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| 299 |
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| 300 |
|
|
; u0|mm_interconnect_0|timecode_tx_data_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|db_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 301 |
|
|
; u0|mm_interconnect_0|timecode_tx_data_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|db_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 302 |
|
|
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| 303 |
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|
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| 304 |
|
|
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| 305 |
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|
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| 306 |
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|
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| 307 |
|
|
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| 308 |
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| 309 |
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|
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| 310 |
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| 312 |
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| 313 |
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|
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| 315 |
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| 316 |
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| 317 |
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| 318 |
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| 319 |
|
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|
| 320 |
|
|
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|
| 321 |
|
|
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|
| 322 |
|
|
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|
| 323 |
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|
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| 324 |
|
|
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|
| 325 |
|
|
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| 326 |
|
|
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|
| 327 |
|
|
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|
| 328 |
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|
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|
| 329 |
|
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|
| 330 |
|
|
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|
| 331 |
|
|
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|
| 332 |
|
|
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|
| 333 |
|
|
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|
| 334 |
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|
| 335 |
|
|
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|
| 336 |
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|
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|
| 337 |
|
|
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|
| 338 |
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|
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|
| 339 |
|
|
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|
| 340 |
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| 341 |
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| 342 |
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| 343 |
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| 344 |
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| 345 |
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| 346 |
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| 347 |
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| 348 |
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; u0|mm_interconnect_0|fifo_full_tx_status_s1_burst_adapter ; 157 ; 0 ; 0 ; 0 ; 155 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 349 |
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|
; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|dc_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 350 |
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; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|dc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 351 |
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|
; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|db_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 352 |
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|
; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|db_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 353 |
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; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|da_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 354 |
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; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|da_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 355 |
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; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|bc_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 356 |
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; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|bc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 357 |
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; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ac_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 358 |
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; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ac_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 359 |
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; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ab_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 360 |
|
|
; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ab_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 361 |
|
|
; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min ; 31 ; 0 ; 2 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 362 |
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|
; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_burstwrap_increment ; 7 ; 0 ; 0 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 363 |
|
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; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|align_address_to_size ; 38 ; 5 ; 0 ; 5 ; 32 ; 5 ; 5 ; 5 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 364 |
|
|
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| 365 |
|
|
; u0|mm_interconnect_0|write_en_tx_s1_burst_adapter ; 157 ; 0 ; 0 ; 0 ; 155 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 366 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|dc_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 367 |
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|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|dc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 368 |
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|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|db_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 369 |
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|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|db_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 370 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|da_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 371 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|da_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 372 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|bc_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 373 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|bc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 374 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ac_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 375 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ac_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 376 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ab_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 377 |
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|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ab_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 378 |
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|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min ; 31 ; 0 ; 2 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 379 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_burstwrap_increment ; 7 ; 0 ; 0 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 380 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|align_address_to_size ; 38 ; 5 ; 0 ; 5 ; 32 ; 5 ; 5 ; 5 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 381 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter ; 157 ; 0 ; 0 ; 0 ; 155 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 382 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_burst_adapter ; 157 ; 0 ; 0 ; 0 ; 155 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 383 |
|
|
; u0|mm_interconnect_0|link_disable_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|dc_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 384 |
|
|
; u0|mm_interconnect_0|link_disable_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|dc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 385 |
|
|
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|
| 386 |
|
|
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| 387 |
|
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|
| 388 |
|
|
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|
| 389 |
|
|
; u0|mm_interconnect_0|link_disable_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|bc_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 390 |
|
|
; u0|mm_interconnect_0|link_disable_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|bc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 391 |
|
|
; u0|mm_interconnect_0|link_disable_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ac_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 392 |
|
|
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|
| 393 |
|
|
; u0|mm_interconnect_0|link_disable_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ab_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 394 |
|
|
; u0|mm_interconnect_0|link_disable_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ab_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 395 |
|
|
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|
| 396 |
|
|
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|
| 397 |
|
|
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|
| 398 |
|
|
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|
| 399 |
|
|
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|
| 400 |
|
|
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|
| 401 |
|
|
; u0|mm_interconnect_0|auto_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|dc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 402 |
|
|
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|
| 403 |
|
|
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|
| 404 |
|
|
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|
| 405 |
|
|
; u0|mm_interconnect_0|auto_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|da_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 406 |
|
|
; u0|mm_interconnect_0|auto_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|bc_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 407 |
|
|
; u0|mm_interconnect_0|auto_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|bc_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 408 |
|
|
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|
| 409 |
|
|
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|
| 410 |
|
|
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|
| 411 |
|
|
; u0|mm_interconnect_0|auto_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|ab_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 412 |
|
|
; u0|mm_interconnect_0|auto_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min ; 31 ; 0 ; 2 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 413 |
|
|
; u0|mm_interconnect_0|auto_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_burstwrap_increment ; 7 ; 0 ; 0 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 414 |
|
|
; u0|mm_interconnect_0|auto_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|align_address_to_size ; 38 ; 5 ; 0 ; 5 ; 32 ; 5 ; 5 ; 5 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 415 |
|
|
; u0|mm_interconnect_0|auto_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter ; 157 ; 0 ; 0 ; 0 ; 155 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 416 |
|
|
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|
| 417 |
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|
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|
| 418 |
|
|
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|
| 419 |
|
|
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|
| 420 |
|
|
; u0|mm_interconnect_0|link_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|db_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 421 |
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|
; u0|mm_interconnect_0|link_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|da_sub|subtract ; 17 ; 1 ; 0 ; 1 ; 8 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 422 |
|
|
; u0|mm_interconnect_0|link_start_s1_burst_adapter|altera_merlin_burst_adapter_13_1.burst_adapter|the_min|da_sub ; 16 ; 2 ; 0 ; 2 ; 8 ; 2 ; 2 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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| 423 |
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| 424 |
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| 425 |
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| 426 |
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| 427 |
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| 428 |
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| 429 |
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| 430 |
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| 433 |
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| 435 |
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| 436 |
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| 437 |
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| 438 |
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| 439 |
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| 440 |
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| 441 |
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| 443 |
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|
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| 444 |
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| 445 |
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| 446 |
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| 447 |
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| 449 |
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| 450 |
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|
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| 451 |
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| 452 |
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| 453 |
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| 454 |
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| 455 |
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| 456 |
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|
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| 457 |
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| 458 |
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| 459 |
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| 460 |
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|
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|
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|
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|
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|
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|
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|
|
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| 476 |
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| 479 |
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| 480 |
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|
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|
| 483 |
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|
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|
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| 488 |
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| 490 |
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| 495 |
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| 497 |
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| 498 |
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| 499 |
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| 500 |
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| 501 |
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| 502 |
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| 503 |
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| 504 |
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| 505 |
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| 506 |
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| 507 |
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| 508 |
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| 509 |
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| 510 |
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| 511 |
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| 512 |
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| 513 |
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| 514 |
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| 515 |
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| 516 |
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| 517 |
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|
| 518 |
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|
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| 519 |
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|
| 520 |
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|
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| 521 |
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|
| 522 |
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|
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| 523 |
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| 524 |
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|
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| 525 |
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| 526 |
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|
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| 527 |
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| 528 |
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|
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|
| 529 |
|
|
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|
| 530 |
|
|
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| 531 |
|
|
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|
| 532 |
|
|
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|
| 533 |
|
|
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| 537 |
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|
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| 539 |
|
|
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|
| 540 |
|
|
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|
| 541 |
|
|
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|
| 542 |
|
|
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|
| 543 |
|
|
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|
| 544 |
|
|
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|
| 545 |
|
|
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| 546 |
|
|
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|
| 547 |
|
|
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|
| 548 |
|
|
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|
| 549 |
|
|
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|
| 550 |
|
|
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|
| 551 |
|
|
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|
| 552 |
|
|
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|
| 553 |
|
|
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|
| 554 |
|
|
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|
| 555 |
|
|
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|
| 556 |
|
|
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|
| 557 |
|
|
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|
| 558 |
|
|
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|
| 559 |
|
|
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|
| 560 |
|
|
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|
| 561 |
|
|
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|
| 562 |
|
|
; u0|mm_interconnect_0|router_020 ; 135 ; 0 ; 2 ; 0 ; 155 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 563 |
|
|
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|
| 564 |
|
|
; u0|mm_interconnect_0|router_019 ; 135 ; 0 ; 2 ; 0 ; 155 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 565 |
|
|
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|
| 566 |
|
|
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|
| 567 |
|
|
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|
| 568 |
|
|
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|
| 569 |
|
|
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|
| 570 |
|
|
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|
| 571 |
|
|
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|
| 572 |
|
|
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|
| 573 |
|
|
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|
| 574 |
|
|
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|
| 575 |
|
|
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|
| 576 |
|
|
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|
| 577 |
|
|
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|
| 578 |
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| 579 |
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| 580 |
|
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| 581 |
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| 582 |
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| 583 |
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| 584 |
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| 594 |
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|
| 598 |
|
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|
| 600 |
|
|
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|
| 601 |
|
|
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|
| 602 |
|
|
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|
| 603 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 604 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 605 |
|
|
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|
| 606 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_agent ; 365 ; 39 ; 59 ; 39 ; 376 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 607 |
|
|
; u0|mm_interconnect_0|counter_tx_fifo_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 608 |
|
|
; u0|mm_interconnect_0|counter_tx_fifo_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 609 |
|
|
; u0|mm_interconnect_0|counter_tx_fifo_s1_agent|uncompressor ; 54 ; 1 ; 0 ; 1 ; 52 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 610 |
|
|
; u0|mm_interconnect_0|counter_tx_fifo_s1_agent ; 365 ; 39 ; 59 ; 39 ; 376 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 611 |
|
|
; u0|mm_interconnect_0|fsm_info_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 612 |
|
|
; u0|mm_interconnect_0|fsm_info_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 613 |
|
|
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|
| 614 |
|
|
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|
| 615 |
|
|
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|
| 616 |
|
|
; u0|mm_interconnect_0|clock_sel_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 617 |
|
|
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|
| 618 |
|
|
; u0|mm_interconnect_0|clock_sel_s1_agent ; 365 ; 39 ; 59 ; 39 ; 376 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 619 |
|
|
; u0|mm_interconnect_0|data_info_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 620 |
|
|
; u0|mm_interconnect_0|data_info_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 621 |
|
|
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|
| 622 |
|
|
; u0|mm_interconnect_0|data_info_s1_agent ; 365 ; 39 ; 59 ; 39 ; 376 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 623 |
|
|
; u0|mm_interconnect_0|timecode_tx_ready_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 624 |
|
|
; u0|mm_interconnect_0|timecode_tx_ready_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 625 |
|
|
; u0|mm_interconnect_0|timecode_tx_ready_s1_agent|uncompressor ; 54 ; 1 ; 0 ; 1 ; 52 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 626 |
|
|
; u0|mm_interconnect_0|timecode_tx_ready_s1_agent ; 365 ; 39 ; 59 ; 39 ; 376 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 627 |
|
|
; u0|mm_interconnect_0|timecode_tx_enable_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 628 |
|
|
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|
| 629 |
|
|
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|
| 630 |
|
|
; u0|mm_interconnect_0|timecode_tx_enable_s1_agent ; 365 ; 39 ; 59 ; 39 ; 376 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 631 |
|
|
; u0|mm_interconnect_0|timecode_tx_data_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 632 |
|
|
; u0|mm_interconnect_0|timecode_tx_data_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 633 |
|
|
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|
| 634 |
|
|
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|
| 635 |
|
|
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|
| 636 |
|
|
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|
| 637 |
|
|
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|
| 638 |
|
|
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|
| 639 |
|
|
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|
| 640 |
|
|
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|
| 641 |
|
|
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|
| 642 |
|
|
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|
| 643 |
|
|
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|
| 644 |
|
|
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|
| 645 |
|
|
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|
| 646 |
|
|
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|
| 647 |
|
|
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|
| 648 |
|
|
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|
| 649 |
|
|
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|
| 650 |
|
|
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|
| 651 |
|
|
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|
| 652 |
|
|
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|
| 653 |
|
|
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|
| 654 |
|
|
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|
| 655 |
|
|
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|
| 656 |
|
|
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|
| 657 |
|
|
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|
| 658 |
|
|
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|
| 659 |
|
|
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|
| 660 |
|
|
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|
| 661 |
|
|
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|
| 662 |
|
|
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|
| 663 |
|
|
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|
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|
|
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|
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|
| 666 |
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|
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|
| 667 |
|
|
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|
| 668 |
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|
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|
| 669 |
|
|
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|
| 670 |
|
|
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|
| 671 |
|
|
; u0|mm_interconnect_0|data_read_en_rx_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 672 |
|
|
; u0|mm_interconnect_0|data_read_en_rx_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 673 |
|
|
; u0|mm_interconnect_0|data_read_en_rx_s1_agent|uncompressor ; 54 ; 1 ; 0 ; 1 ; 52 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 674 |
|
|
; u0|mm_interconnect_0|data_read_en_rx_s1_agent ; 365 ; 39 ; 59 ; 39 ; 376 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 675 |
|
|
; u0|mm_interconnect_0|data_flag_rx_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 676 |
|
|
; u0|mm_interconnect_0|data_flag_rx_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 677 |
|
|
; u0|mm_interconnect_0|data_flag_rx_s1_agent|uncompressor ; 54 ; 1 ; 0 ; 1 ; 52 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 678 |
|
|
; u0|mm_interconnect_0|data_flag_rx_s1_agent ; 365 ; 39 ; 59 ; 39 ; 376 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 679 |
|
|
; u0|mm_interconnect_0|timecode_ready_rx_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 680 |
|
|
; u0|mm_interconnect_0|timecode_ready_rx_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 681 |
|
|
; u0|mm_interconnect_0|timecode_ready_rx_s1_agent|uncompressor ; 54 ; 1 ; 0 ; 1 ; 52 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 682 |
|
|
; u0|mm_interconnect_0|timecode_ready_rx_s1_agent ; 365 ; 39 ; 59 ; 39 ; 376 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 683 |
|
|
; u0|mm_interconnect_0|timecode_rx_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 684 |
|
|
; u0|mm_interconnect_0|timecode_rx_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 685 |
|
|
; u0|mm_interconnect_0|timecode_rx_s1_agent|uncompressor ; 54 ; 1 ; 0 ; 1 ; 52 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 686 |
|
|
; u0|mm_interconnect_0|timecode_rx_s1_agent ; 365 ; 39 ; 59 ; 39 ; 376 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 687 |
|
|
; u0|mm_interconnect_0|led_pio_test_s1_agent_rdata_fifo ; 79 ; 41 ; 0 ; 41 ; 36 ; 41 ; 41 ; 41 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 688 |
|
|
; u0|mm_interconnect_0|led_pio_test_s1_agent_rsp_fifo ; 175 ; 39 ; 0 ; 39 ; 134 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 689 |
|
|
; u0|mm_interconnect_0|led_pio_test_s1_agent|uncompressor ; 54 ; 1 ; 0 ; 1 ; 52 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 690 |
|
|
; u0|mm_interconnect_0|led_pio_test_s1_agent ; 365 ; 39 ; 59 ; 39 ; 376 ; 39 ; 39 ; 39 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 691 |
|
|
; u0|mm_interconnect_0|hps_0_h2f_axi_master_agent|align_address_to_size ; 47 ; 0 ; 1 ; 0 ; 32 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 692 |
|
|
; u0|mm_interconnect_0|hps_0_h2f_axi_master_agent ; 505 ; 99 ; 257 ; 99 ; 332 ; 99 ; 99 ; 99 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 693 |
|
|
; u0|mm_interconnect_0|counter_rx_fifo_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 694 |
|
|
; u0|mm_interconnect_0|counter_tx_fifo_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 695 |
|
|
; u0|mm_interconnect_0|fsm_info_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 696 |
|
|
; u0|mm_interconnect_0|clock_sel_s1_translator ; 113 ; 6 ; 31 ; 6 ; 70 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 697 |
|
|
; u0|mm_interconnect_0|data_info_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 698 |
|
|
; u0|mm_interconnect_0|timecode_tx_ready_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 699 |
|
|
; u0|mm_interconnect_0|timecode_tx_enable_s1_translator ; 113 ; 6 ; 31 ; 6 ; 70 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 700 |
|
|
; u0|mm_interconnect_0|timecode_tx_data_s1_translator ; 113 ; 6 ; 31 ; 6 ; 70 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 701 |
|
|
; u0|mm_interconnect_0|fifo_empty_tx_status_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 702 |
|
|
; u0|mm_interconnect_0|fifo_full_tx_status_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 703 |
|
|
; u0|mm_interconnect_0|write_en_tx_s1_translator ; 113 ; 6 ; 31 ; 6 ; 70 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 704 |
|
|
; u0|mm_interconnect_0|write_data_fifo_tx_s1_translator ; 113 ; 6 ; 31 ; 6 ; 70 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 705 |
|
|
; u0|mm_interconnect_0|link_disable_s1_translator ; 113 ; 6 ; 31 ; 6 ; 70 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 706 |
|
|
; u0|mm_interconnect_0|auto_start_s1_translator ; 113 ; 6 ; 31 ; 6 ; 70 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 707 |
|
|
; u0|mm_interconnect_0|link_start_s1_translator ; 113 ; 6 ; 31 ; 6 ; 70 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 708 |
|
|
; u0|mm_interconnect_0|fifo_empty_rx_status_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 709 |
|
|
; u0|mm_interconnect_0|fifo_full_rx_status_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 710 |
|
|
; u0|mm_interconnect_0|data_read_en_rx_s1_translator ; 113 ; 6 ; 31 ; 6 ; 70 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 711 |
|
|
; u0|mm_interconnect_0|data_flag_rx_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 712 |
|
|
; u0|mm_interconnect_0|timecode_ready_rx_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 713 |
|
|
; u0|mm_interconnect_0|timecode_rx_s1_translator ; 113 ; 6 ; 31 ; 6 ; 36 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 714 |
|
|
; u0|mm_interconnect_0|led_pio_test_s1_translator ; 113 ; 6 ; 31 ; 6 ; 70 ; 6 ; 6 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 715 |
|
|
; u0|mm_interconnect_0 ; 881 ; 0 ; 0 ; 0 ; 450 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 716 |
|
|
; u0|write_en_tx ; 38 ; 31 ; 31 ; 31 ; 33 ; 31 ; 31 ; 31 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 717 |
|
|
; u0|write_data_fifo_tx ; 38 ; 23 ; 23 ; 23 ; 41 ; 23 ; 23 ; 23 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 718 |
|
|
; u0|timecode_tx_ready ; 5 ; 0 ; 0 ; 0 ; 32 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 719 |
|
|
; u0|timecode_tx_enable ; 38 ; 31 ; 31 ; 31 ; 33 ; 31 ; 31 ; 31 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 720 |
|
|
; u0|timecode_tx_data ; 38 ; 24 ; 24 ; 24 ; 40 ; 24 ; 24 ; 24 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 721 |
|
|
; u0|timecode_rx ; 12 ; 0 ; 0 ; 0 ; 32 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 722 |
|
|
; u0|timecode_ready_rx ; 5 ; 0 ; 0 ; 0 ; 32 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 723 |
|
|
; u0|pll_0 ; 2 ; 0 ; 0 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 724 |
|
|
; u0|link_start ; 38 ; 31 ; 31 ; 31 ; 33 ; 31 ; 31 ; 31 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 725 |
|
|
; u0|link_disable ; 38 ; 31 ; 31 ; 31 ; 33 ; 31 ; 31 ; 31 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 726 |
|
|
; u0|led_pio_test ; 38 ; 27 ; 27 ; 27 ; 37 ; 27 ; 27 ; 27 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 727 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|dll ; 2 ; 0 ; 0 ; 0 ; 7 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 728 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|oct ; 1 ; 0 ; 0 ; 0 ; 32 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 729 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|c0 ; 228 ; 173 ; 8 ; 173 ; 280 ; 173 ; 173 ; 173 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 730 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|seq ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 731 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|dq_ddio[0].ubidir_dq_dqs|altdq_dqs2_inst ; 135 ; 1 ; 3 ; 1 ; 36 ; 1 ; 1 ; 1 ; 10 ; 0 ; 0 ; 0 ; 0 ;
|
| 732 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|dq_ddio[0].ubidir_dq_dqs ; 135 ; 0 ; 0 ; 0 ; 36 ; 0 ; 0 ; 0 ; 10 ; 0 ; 0 ; 0 ; 0 ;
|
| 733 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|clock_gen[0].uclk_generator ; 1 ; 0 ; 0 ; 0 ; 2 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 734 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|clock_gen[0].umem_ck_pad|auto_generated ; 3 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 735 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|ureset_n_pad ; 7 ; 1 ; 0 ; 1 ; 1 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 736 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|ucmd_pad ; 37 ; 1 ; 0 ; 1 ; 6 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 737 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|ubank_pad ; 19 ; 1 ; 0 ; 1 ; 3 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 738 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|uaddress_pad ; 79 ; 1 ; 0 ; 1 ; 13 ; 1 ; 1 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 739 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[22].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 740 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[21].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 741 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[20].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 742 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[19].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 743 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[18].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 744 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[17].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 745 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[16].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 746 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[15].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 747 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[14].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 748 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[13].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 749 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[12].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 750 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[11].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 751 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[10].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 752 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[9].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 753 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[8].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 754 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[7].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 755 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[6].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 756 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[5].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 757 |
|
|
; u0|hps_0|hps_io|border|hps_sdram_inst|p0|umemphy|uio_pads|uaddr_cmd_pads|address_gen[4].acv_ac_ldc ; 10 ; 0 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
|
| 758 |
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